文件名称:pipeline
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所属分类：
- 标签属性：
- 上传时间：2012-11-16
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文件大小：8.06kb
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提 供 者：
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相关连接：无下载说明：别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容来自于网络，使用问题请自行百度
以Verilog撰寫而成的Booth’s Algorithm Multiplier，並以Pipeline方式實現。-Written in the Verilog Booth' s Algorithm Multiplier, and the Pipeline way.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
pipeline/alu.v
pipeline/alu_ctl.v
pipeline/CLA_32bits.v
pipeline/CLA_32bit_finish.v
pipeline/CLA_8bit.v
pipeline/control_unit.v
pipeline/CPU.v
pipeline/data_memory.v
pipeline/instruction_memory.v
pipeline/INVERTB.v
pipeline/mux2to1.v
pipeline/mux2to1_5bits.v
pipeline/mux4to1.v
pipeline/read1.dat
pipeline/reg_file.v
pipeline/sll.v
pipeline/TestCPU.v
pipeline
pipeline/alu_ctl.v
pipeline/CLA_32bits.v
pipeline/CLA_32bit_finish.v
pipeline/CLA_8bit.v
pipeline/control_unit.v
pipeline/CPU.v
pipeline/data_memory.v
pipeline/instruction_memory.v
pipeline/INVERTB.v
pipeline/mux2to1.v
pipeline/mux2to1_5bits.v
pipeline/mux4to1.v
pipeline/read1.dat
pipeline/reg_file.v
pipeline/sll.v
pipeline/TestCPU.v
pipeline
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