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文件名称:RISC-CPU-design

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    404.13kb
  • 已下载：
    0次
  • 提 供 者：
    y***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

16位RISC-CPU设计，高四位为操作码，低12位为地址，寻址空间位4KB。包含12条指令（预设16条指令），3个基本测试文件及其Modelsim仿真结果。-16-bit RISC-CPU design, the high four bits for the opcode, the lower 12 address, the address space of 4KB. Consists of 12 instructions (default 16 instructions), the three basic test file and Modelsim simulation results.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

RISC CPU design/
RISC CPU design/CPU Design.pdf
RISC CPU design/Screenshot-1.png
RISC CPU design/Screenshot-2.png
RISC CPU design/Screenshot.png
RISC CPU design/accum.v
RISC CPU design/addr_decode.v
RISC CPU design/adr.v
RISC CPU design/alu.v
RISC CPU design/clk_gen.v
RISC CPU design/counter.v
RISC CPU design/cpu.v
RISC CPU design/datactl.v
RISC CPU design/machine.v
RISC CPU design/machinectl.v
RISC CPU design/out_reg.v
RISC CPU design/ram.v
RISC CPU design/register.v
RISC CPU design/rom.v
RISC CPU design/t.v
RISC CPU design/test result.txt
RISC CPU design/test1.dat
RISC CPU design/test1.png
RISC CPU design/test1.pro
RISC CPU design/test2.dat
RISC CPU design/test2.png
RISC CPU design/test2.pro
RISC CPU design/test3.dat
RISC CPU design/test3.png
RISC CPU design/test3.pro

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