文件名称:v16bbit_boothe
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- 上传时间：2012-11-16
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文件大小：2.04kb
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verilog程序源码，实现两个16bit数乘法，使用booth算法，一种基于状态机实现，分层层次为datapath与controller两个子模块，testBench测试通过
-verilog program source code, and two 16bit multiplication using booth algorithm, based on the state machine implementation, the hierarchical level for the datapath and controller two sub-modules testBench tested
-verilog program source code, and two 16bit multiplication using booth algorithm, based on the state machine implementation, the hierarchical level for the datapath and controller two sub-modules testBench tested
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下载文件列表
v16bbit_boothe/Booth_Multiplier_STG.v
v16bbit_boothe/Controller.v
v16bbit_boothe/Datapath.v
v16bbit_boothe/testBench.v
v16bbit_boothe
v16bbit_boothe/Controller.v
v16bbit_boothe/Datapath.v
v16bbit_boothe/testBench.v
v16bbit_boothe
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