文件名称:VFIFOzipe
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所属分类：
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- 上传时间：2012-11-16
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文件大小：2.38kb
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用verilog实现异步FIFO，代码中有两个模块，使用时时注意顶层模块和底层模块，用quartus2即可打开直接使用。
-Asynchronous FIFO, with verilog code has two modules, using the constant attention of top-level module and bottom module with quartus2 to open.
-Asynchronous FIFO, with verilog code has two modules, using the constant attention of top-level module and bottom module with quartus2 to open.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
VFIFOzipe/async_cmp.v
VFIFOzipe/async_fifo.v
VFIFOzipe/dp_ram.v
VFIFOzipe/rptr_empty.v
VFIFOzipe/wptr_full.v
VFIFOzipe
VFIFOzipe/async_fifo.v
VFIFOzipe/dp_ram.v
VFIFOzipe/rptr_empty.v
VFIFOzipe/wptr_full.v
VFIFOzipe
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