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文件名称:LLVDDSzipV

  • 所属分类：
    Windows Develop
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    127.57kb
  • 已下载：
    0次
  • 提 供 者：
    zzhp****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

以LVDS设计为例学习ISE中的时序分析和低层布局器的使用方法 在底层布局器中对LVDS管脚进行约约束的方法，底层布局器设计流程，底层布局器中的位置约束，时序分析器的使用方法，时序改进向导的使用等.

-Location constraints, timing analyzer designed to LVDS LVDS pin about constraints in the underlying layout example to learn the use of the ISE timing analysis and low-level layout' s method, the underlying layout design process, the underlying layout the use of methods, the timing improvements Wizard.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

LLVDDSzipV/6_1pro/6_1pro.jid
LLVDDSzipV/6_1pro/6_1pro.npl
LLVDDSzipV/6_1pro/6_1pro.ptf
LLVDDSzipV/6_1pro/automake.log
LLVDDSzipV/6_1pro/chkdata.err
LLVDDSzipV/6_1pro/ddrfd.jhd
LLVDDSzipV/6_1pro/load_gen.jhd
LLVDDSzipV/6_1pro/m2_1.jhd
LLVDDSzipV/6_1pro/par.opt
LLVDDSzipV/6_1pro/piso.jhd
LLVDDSzipV/6_1pro/tx2bit.bld
LLVDDSzipV/6_1pro/tx2bit.cel
LLVDDSzipV/6_1pro/tx2bit.dly
LLVDDSzipV/6_1pro/tx2bit.fnf
LLVDDSzipV/6_1pro/tx2bit.jhd
LLVDDSzipV/6_1pro/tx2bit.mrp
LLVDDSzipV/6_1pro/tx2bit.nc1
LLVDDSzipV/6_1pro/tx2bit.ncd
LLVDDSzipV/6_1pro/tx2bit.ngc
LLVDDSzipV/6_1pro/tx2bit.ngd
LLVDDSzipV/6_1pro/tx2bit.ngm
LLVDDSzipV/6_1pro/tx2bit.pad
LLVDDSzipV/6_1pro/tx2bit.par
LLVDDSzipV/6_1pro/tx2bit.pcf
LLVDDSzipV/6_1pro/tx2bit.prj
LLVDDSzipV/6_1pro/tx2bit.sdc
LLVDDSzipV/6_1pro/tx2bit.syr
LLVDDSzipV/6_1pro/tx2bit.tlg
LLVDDSzipV/6_1pro/tx2bit.twr
LLVDDSzipV/6_1pro/tx2bit.twx
LLVDDSzipV/6_1pro/tx2bit.ucf
LLVDDSzipV/6_1pro/tx2bit.ucf.bak
LLVDDSzipV/6_1pro/tx2bit.xpi
LLVDDSzipV/6_1pro/tx2bit.xst
LLVDDSzipV/6_1pro/tx2bit._prj
LLVDDSzipV/6_1pro/tx2bit_compile.tcl
LLVDDSzipV/6_1pro/tx2bit_fpga_editor.out
LLVDDSzipV/6_1pro/tx2bit_fpga_editor_021214_121857.log
LLVDDSzipV/6_1pro/tx2bit_fpga_editor_021215_160731.log
LLVDDSzipV/6_1pro/tx2bit_last_ngd.ngd
LLVDDSzipV/6_1pro/tx2bit_last_ngd_report.bld
LLVDDSzipV/6_1pro/tx2bit_last_par.ncd
LLVDDSzipV/6_1pro/tx2bit_map.mfp
LLVDDSzipV/6_1pro/tx2bit_map.ncd
LLVDDSzipV/6_1pro/tx2bit_map_fpga_editor_021214_112102.log
LLVDDSzipV/6_1pro/tx2bit_ngdbuild.nav
LLVDDSzipV/6_1pro/_editucf.err
LLVDDSzipV/6_1pro/_editucf.rsp
LLVDDSzipV/6_1pro/_editucf_exewrap.rsp
LLVDDSzipV/6_1pro/_map.log
LLVDDSzipV/6_1pro/_map.rsp
LLVDDSzipV/6_1pro/_nc1TOncd_exewrap.rsp
LLVDDSzipV/6_1pro/_ncdTOtwr_exewrap.rsp
LLVDDSzipV/6_1pro/_ngdTOnc1_exewrap.rsp
LLVDDSzipV/6_1pro/_ngo/netlist.lst
LLVDDSzipV/6_1pro/_par.log
LLVDDSzipV/6_1pro/_par.rsp
LLVDDSzipV/6_1pro/_prepar.rsp
LLVDDSzipV/6_1pro/__constEditor_exewrap.rsp
LLVDDSzipV/6_1pro/__ednTOngd_exewrap.rsp
LLVDDSzipV/6_1pro/__filesAllClean.fac
LLVDDSzipV/6_1pro/__launchSyn.tcl
LLVDDSzipV/6_1pro/__launchTA.tcl
LLVDDSzipV/6_1pro/__mapFloorPlanner.rsp
LLVDDSzipV/6_1pro/__mapFloorPlannerAppExewrap.rsp
LLVDDSzipV/6_1pro/__ngdbuild.rsp
LLVDDSzipV/6_1pro/__parFloorPlanner.rsp
LLVDDSzipV/6_1pro/__parFloorPlannerAppExewrap.rsp
LLVDDSzipV/6_1pro/__posttrc.log
LLVDDSzipV/6_1pro/__posttrc.rsp
LLVDDSzipV/6_1pro/__projnav.log
LLVDDSzipV/6_1pro/__tx2bit_2prj_exewrap.rsp
LLVDDSzipV/6_1pro/__tx2bit_mapFloorPlanner.err
LLVDDSzipV/6_1pro/__tx2bit_parFloorPlanner.err
LLVDDSzipV/Source/ddrfd.v
LLVDDSzipV/Source/ddrfd.v.bak
LLVDDSzipV/Source/load_gen.v
LLVDDSzipV/Source/m2_1.v
LLVDDSzipV/Source/m2_1.v.bak
LLVDDSzipV/Source/piso.v
LLVDDSzipV/Source/tx2bit.cel
LLVDDSzipV/Source/tx2bit.ucf
LLVDDSzipV/Source/tx2bit.v
LLVDDSzipV/6_1pro/_ngo
LLVDDSzipV/6_1pro
LLVDDSzipV/Source
LLVDDSzipV

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