文件名称:Basic-sequential-logic
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- 上传时间:2012-11-16
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用Verilog语言实现D触发器、累加器的功能-D flip-flop, the function of the accumulator using Verilog language
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2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.qpf
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.sof
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.v
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.vwf
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.qpf
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.sof
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.v
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.vwf
2基本时序逻辑/D触发器设计/移位寄存器/register.qpf
2基本时序逻辑/D触发器设计/移位寄存器/register.sof
2基本时序逻辑/D触发器设计/移位寄存器/register.v
2基本时序逻辑/D触发器设计/移位寄存器/register.vwf
2基本时序逻辑/累加器/accmulator.qpf
2基本时序逻辑/累加器/accmulator.sof
2基本时序逻辑/累加器/accmulator.v
2基本时序逻辑/累加器/accmulator.vwf
2基本时序逻辑/累加器/adderfourbit.v
2基本时序逻辑/累加器/Dactivity.v
2基本时序逻辑/累加器/FullAdder.v
2基本时序逻辑/D触发器设计/D触发器行为级
2基本时序逻辑/D触发器设计/D触发器门级
2基本时序逻辑/D触发器设计/移位寄存器
2基本时序逻辑/D触发器设计
2基本时序逻辑/累加器
2基本时序逻辑
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.sof
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.v
2基本时序逻辑/D触发器设计/D触发器行为级/Dactivity.vwf
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.qpf
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.sof
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.v
2基本时序逻辑/D触发器设计/D触发器门级/D_trigger_act.vwf
2基本时序逻辑/D触发器设计/移位寄存器/register.qpf
2基本时序逻辑/D触发器设计/移位寄存器/register.sof
2基本时序逻辑/D触发器设计/移位寄存器/register.v
2基本时序逻辑/D触发器设计/移位寄存器/register.vwf
2基本时序逻辑/累加器/accmulator.qpf
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2基本时序逻辑/累加器/adderfourbit.v
2基本时序逻辑/累加器/Dactivity.v
2基本时序逻辑/累加器/FullAdder.v
2基本时序逻辑/D触发器设计/D触发器行为级
2基本时序逻辑/D触发器设计/D触发器门级
2基本时序逻辑/D触发器设计/移位寄存器
2基本时序逻辑/D触发器设计
2基本时序逻辑/累加器
2基本时序逻辑
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