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文件名称:jiafaqi

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  • 上传时间:
    2012-11-16
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    438.1kb
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利用FPGA,VHDL设计一个加法器控制LED。-The use of FPGA, VHDL design an adder control LED.
(系统自动生成,下载前可以参看下载内容)

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11实验十一:加法器数码管显示/
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11实验十一:加法器数码管显示/db/sub.pre_map.hdb
11实验十一:加法器数码管显示/db/sub.rtlv.hdb
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11实验十一:加法器数码管显示/db/sub.rtlv_sg_swap.cdb
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11实验十一:加法器数码管显示/db/sub.sgdiff.hdb
11实验十一:加法器数码管显示/db/sub.sld_design_entry.sci
11实验十一:加法器数码管显示/db/sub.sld_design_entry_dsc.sci
11实验十一:加法器数码管显示/db/sub.syn_hier_info
11实验十一:加法器数码管显示/db/sub.tan.qmsg
11实验十一:加法器数码管显示/db/sub.tis_db_list.ddb
11实验十一:加法器数码管显示/db/sub.tmw_info
11实验十一:加法器数码管显示/db/sub_cmp.qrpt
11实验十一:加法器数码管显示/incremental_db/
11实验十一:加法器数码管显示/incremental_db/README
11实验十一:加法器数码管显示/incremental_db/compiled_partitions/
11实验十一:加法器数码管显示/incremental_db/compiled_partitions/add.root_partition.map.kpt
11实验十一:加法器数码管显示/incremental_db/compiled_partitions/sub.root_partition.map.kpt
11实验十一:加法器数码管显示/transcript

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