文件名称:vhdl_text1
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- 上传时间：2012-11-16
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1. 设计、仿真 and3、or3、dff的时序特性。
2. 设计138译码器，仿真其时序特性。器件选择MAX7128SLC84-7，指定管脚按照从小到大的顺序排列。-Design, simulation and3, or3, dff timing characteristics. Design 138 decoder, simulation timing characteristics. The device selection MAX7128SLC84-7, specify pins arranged in the order of small to large.
2. 设计138译码器，仿真其时序特性。器件选择MAX7128SLC84-7，指定管脚按照从小到大的顺序排列。-Design, simulation and3, or3, dff timing characteristics. Design 138 decoder, simulation timing characteristics. The device selection MAX7128SLC84-7, specify pins arranged in the order of small to large.
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vhdl_text1/138.bdf
vhdl_text1/ex1.bdf
vhdl_text1
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vhdl_text1
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