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文件名称:VREILOG-HDL-clock-source-code

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2013-01-09
  • 文件大小:
    76.37kb
  • 已下载:
    0次
  • 提 供 者:
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

VREILOG HDL clock source code,VREILOG HDL数字时钟 源代码。-VREILOG HDL clock source code
(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock/clock.asm.rpt
clock/clock.bsf
clock/clock.done
clock/clock.fit.rpt
clock/clock.fit.smsg
clock/clock.fit.summary
clock/clock.flow.rpt
clock/clock.map.rpt
clock/clock.map.smsg
clock/clock.map.summary
clock/clock.pin
clock/clock.pof
clock/clock.qpf
clock/clock.qsf
clock/clock.sof
clock/clock.tan.rpt
clock/clock.tan.summary
clock/clock.v
clock/clock.v.bak
clock/clock1.bdf
clock/db/clock.db_info
clock/db/clock.eco.cdb
clock/db/clock.sld_design_entry.sci
clock/div_1k.bsf
clock/div_1k.v
clock/div_1k.v.bak
clock/div_4hz.bsf
clock/div_4hz.v
clock/div_4hz.v.bak
clock/scan_led.bsf
clock/scan_led.v
clock/scan_led.v.bak
clock/db
clock

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