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文件名称:xinhao

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2013-03-16
  • 文件大小：
    59.04kb
  • 已下载：
    0次
  • 提 供 者：
    沈***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

简易信号发生器，可输出三种波形，递增锯齿波发生器模块，正弦波发生器模块，方波发生器模块，波形选择器模块，vhdl-Simple signal generator can output three waveforms, incremental sawtooth generator module, the sine wave generator module, a square wave generator module, waveform selector module, vhdl
(系统自动生成,下载前可以参看下载内容)

下载文件列表

xinhao/Block1.bdf
xinhao/db/sin.(0).cnf.cdb
xinhao/db/sin.(0).cnf.hdb
xinhao/db/sin.cbx.xml
xinhao/db/sin.cmp.rdb
xinhao/db/sin.dbp
xinhao/db/sin.db_info
xinhao/db/sin.eco.cdb
xinhao/db/sin.hier_info
xinhao/db/sin.hif
xinhao/db/sin.map.cdb
xinhao/db/sin.map.hdb
xinhao/db/sin.map.logdb
xinhao/db/sin.map.qmsg
xinhao/db/sin.pre_map.cdb
xinhao/db/sin.pre_map.hdb
xinhao/db/sin.psp
xinhao/db/sin.rtlv.hdb
xinhao/db/sin.rtlv_sg.cdb
xinhao/db/sin.rtlv_sg_swap.cdb
xinhao/db/sin.sgdiff.cdb
xinhao/db/sin.sgdiff.hdb
xinhao/db/sin.sld_design_entry.sci
xinhao/db/sin.sld_design_entry_dsc.sci
xinhao/db/sin.syn_hier_info
xinhao/signal_select.bsf
xinhao/signal_select.vhd
xinhao/sin.bsf
xinhao/sin.done
xinhao/sin.flow.rpt
xinhao/sin.map.rpt
xinhao/sin.map.summary
xinhao/sin.qpf
xinhao/sin.qsf
xinhao/sin.qws
xinhao/sin.vhd
xinhao/up_zigzag.bsf
xinhao/up_zigzag.vhd
xinhao/xwhappy.bsf
xinhao/xwhappy.vhd
xinhao/db
xinhao

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