文件名称:jiafaqi
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- 上传时间:2013-03-16
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用VHDL语言实现对FPGA的程序编写,实现加法器功能。-FPGA program written using VHDL adder function.
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下载文件列表
加法器/sy1/db/prev_cmp_sy1.asm.qmsg
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加法器/sy2/db
加法器/sy1
加法器/sy2
加法器
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