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文件名称:clock_lcd

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-03-23
  • 文件大小：
    6.77mb
  • 已下载：
    0次
  • 提 供 者：
    陈***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于FPGA用verilog实现电子时钟功能,适合初学verilog者-Suitable for beginners verilog verilog achieve FPGA-based electronic clock function
(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock_lcd/clock_lcd.asm.rpt
clock_lcd/clock_lcd.cdf
clock_lcd/clock_lcd.done
clock_lcd/clock_lcd.eda.rpt
clock_lcd/clock_lcd.fit.rpt
clock_lcd/clock_lcd.fit.smsg
clock_lcd/clock_lcd.fit.summary
clock_lcd/clock_lcd.flow.rpt
clock_lcd/clock_lcd.jdi
clock_lcd/clock_lcd.map.rpt
clock_lcd/clock_lcd.map.smsg
clock_lcd/clock_lcd.map.summary
clock_lcd/clock_lcd.pin
clock_lcd/clock_lcd.qpf
clock_lcd/clock_lcd.qsf
clock_lcd/clock_lcd.qws
clock_lcd/clock_lcd.sof
clock_lcd/clock_lcd.sta.rpt
clock_lcd/clock_lcd.sta.summary
clock_lcd/clock_lcd.tis_db_list.ddb
clock_lcd/clock_lcd.v
clock_lcd/clock_lcd.v.bak
clock_lcd/clock_lcd_assignment_defaults.qdf
clock_lcd/Counter.v
clock_lcd/db/altsyncram_1bp3.tdf
clock_lcd/db/altsyncram_1s01.tdf
clock_lcd/db/altsyncram_5024.tdf
clock_lcd/db/altsyncram_knu.tdf
clock_lcd/db/alt_synch_pipe_36d.tdf
clock_lcd/db/alt_synch_pipe_46d.tdf
clock_lcd/db/alt_synch_pipe_8u7.tdf
clock_lcd/db/alt_synch_pipe_9u7.tdf
clock_lcd/db/a_graycounter_d4c.tdf
clock_lcd/db/a_graycounter_e4c.tdf
clock_lcd/db/a_graycounter_im6.tdf
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clock_lcd/db/clock_lcd.(0).cnf.hdb
clock_lcd/db/clock_lcd.(1).cnf.cdb
clock_lcd/db/clock_lcd.(1).cnf.hdb
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clock_lcd/db/clock_lcd.(10).cnf.hdb
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clock_lcd/db/clock_lcd.(11).cnf.hdb
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clock_lcd/db/clock_lcd.(12).cnf.hdb
clock_lcd/db/clock_lcd.(13).cnf.cdb
clock_lcd/db/clock_lcd.(13).cnf.hdb
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clock_lcd/db/clock_lcd.(14).cnf.hdb
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