文件名称:Verilog1
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- 上传时间:2013-04-23
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实现了cic分频功能,分频系数D可变2~32,代码用verilog编写,其中输入数据写入主程序中,便于后人testbench的编写-Cic divide divider coefficient D variable from 2 to 32, the code is written in verilog input data is written to the main program, to facilitate future generations testbench preparation
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Verilog1.v
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