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文件名称:qdq

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2013-07-08
  • 文件大小：
    1.03mb
  • 已下载：
    0次
  • 提 供 者：
    陈****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用VHDL语言实现四路抢答器功能，抢答之后不能再抢答，除非主持人按下复位键。可以显示四个选手分数，显示答题倒计时的时间，主持人可以控制加减分，分数通过显示屏显示。使用软件Quartus Ⅱ，可以将程序导入FPGA并能运行。有竞争模块，显示模块，分频模块，加减控制模块，计数器模块，蜂鸣器模块，译码模块，计分器模块，锁定模块等。-VHDL language with four Responder function can not answer after answer, unless the host press the reset button. Can display four players score countdown time display answer, the moderator can control subtract points, scores through the display. Using software Quartus Ⅱ, the program can be imported FPGA and running. Competitive module, display module, frequency module, plus or minus the control modules, counter modules, buzzer module, decoding module, scoring module, locking module.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

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