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文件名称:FIR

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-07-11
  • 文件大小：
    7.68kb
  • 已下载：
    0次
  • 提 供 者：
    于***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用Verilog语言编写的FIR滤波器,在Xilinx Spartan-6上运行通过,是很好的Verlog程序-Using Verilog language FIR filter, the Xilinx Spartan-6 run through, is a very good program Verlog
(系统自动生成,下载前可以参看下载内容)

下载文件列表

FIR/addr_generater.v
FIR/delay.v
FIR/fir.ucf
FIR/fir.v
FIR/fir_rom.coe
FIR/fir_rom_tb.v
FIR/fir_tb.v
FIR/fir_top.bit
FIR/fir_top.v
FIR/x7seg.v
FIR

相关说明

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