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文件名称:booth-16_16-multiplier

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-08-04
  • 文件大小：
    11.34kb
  • 已下载：
    0次
  • 提 供 者：
    p****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

由verilog编写的利用booth编码的16*16有符号乘法器的代码，没有pipeline-a 16*16 multiplier with booth coding by verilog
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog codes for booth/booth_16bit.v
verilog codes for booth/compressor4_2.v
verilog codes for booth/fulladder.v
verilog codes for booth/halfadder.v
verilog codes for booth/multiplier_16s_booth_top.v
verilog codes for booth/multiplier_16s_testbench_shortver.v
verilog codes for booth/sqcsa_part_2bit.v
verilog codes for booth/sqcsa_part_3bit.v
verilog codes for booth/sqcsa_part_4bit.v
verilog codes for booth/sqcsa_part_5bit.v
verilog codes for booth/sqcsa_part_6bit.v
verilog codes for booth/squareroot_csa_32bit.v
verilog codes for booth/wallacetree_booth.v
verilog codes for booth

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