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文件名称:CP_adder

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2013-09-02
  • 文件大小：
    1kb
  • 已下载：
    0次
  • 提 供 者：
    罗***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog 语言实现数字通信中最先进的技术之一中的OFDM技术中的添加循环前缀，可以减少码间干扰，并实现符号同步-a great complied code of cyclic prefix　for OFDM which is good for intersymbol interference and inter channel interference
(系统自动生成,下载前可以参看下载内容)

下载文件列表

CP_adder.txt

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