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文件名称:CRC_Tst

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2013-10-07
  • 文件大小：
    4.3mb
  • 已下载：
    0次
  • 提 供 者：
    尹****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

关于CRC的发射，以及接受的验证，用Verilog实现，包含testbench验证-About CRC launch, as well as acceptable verification, using Verilog implementation, including verification testbench
(系统自动生成,下载前可以参看下载内容)

下载文件列表

CRC_Tst/CRC_Prj.asm.rpt
CRC_Tst/CRC_Prj.done
CRC_Tst/CRC_Prj.eda.rpt
CRC_Tst/CRC_Prj.fit.rpt
CRC_Tst/CRC_Prj.fit.smsg
CRC_Tst/CRC_Prj.fit.summary
CRC_Tst/CRC_Prj.flow.rpt
CRC_Tst/CRC_Prj.map.rpt
CRC_Tst/CRC_Prj.map.summary
CRC_Tst/CRC_Prj.pin
CRC_Tst/CRC_Prj.pof
CRC_Tst/CRC_Prj.qpf
CRC_Tst/CRC_Prj.qsf
CRC_Tst/CRC_Prj.qws
CRC_Tst/CRC_Prj.sof
CRC_Tst/CRC_Prj.tan.rpt
CRC_Tst/CRC_Prj.tan.summary
CRC_Tst/CRC_Prj.v
CRC_Tst/CRC_Prj.v.bak
CRC_Tst/CRC_Prj_nativelink_simulation.rpt
CRC_Tst/db/CRC_Prj.(0).cnf.cdb
CRC_Tst/db/CRC_Prj.(0).cnf.hdb
CRC_Tst/db/CRC_Prj.(1).cnf.cdb
CRC_Tst/db/CRC_Prj.(1).cnf.hdb
CRC_Tst/db/CRC_Prj.(2).cnf.cdb
CRC_Tst/db/CRC_Prj.(2).cnf.hdb
CRC_Tst/db/CRC_Prj.ae.hdb
CRC_Tst/db/CRC_Prj.asm.qmsg
CRC_Tst/db/CRC_Prj.asm_labs.ddb
CRC_Tst/db/CRC_Prj.cbx.xml
CRC_Tst/db/CRC_Prj.cmp.bpm
CRC_Tst/db/CRC_Prj.cmp.cdb
CRC_Tst/db/CRC_Prj.cmp.ecobp
CRC_Tst/db/CRC_Prj.cmp.hdb
CRC_Tst/db/CRC_Prj.cmp.kpt
CRC_Tst/db/CRC_Prj.cmp.logdb
CRC_Tst/db/CRC_Prj.cmp.rdb
CRC_Tst/db/CRC_Prj.cmp.tdb
CRC_Tst/db/CRC_Prj.cmp0.ddb
CRC_Tst/db/CRC_Prj.cmp2.ddb
CRC_Tst/db/CRC_Prj.cmp_merge.kpt
CRC_Tst/db/CRC_Prj.db_info
CRC_Tst/db/CRC_Prj.eco.cdb
CRC_Tst/db/CRC_Prj.eda.qmsg
CRC_Tst/db/CRC_Prj.fit.qmsg
CRC_Tst/db/CRC_Prj.hier_info
CRC_Tst/db/CRC_Prj.hif
CRC_Tst/db/CRC_Prj.lpc.html
CRC_Tst/db/CRC_Prj.lpc.rdb
CRC_Tst/db/CRC_Prj.lpc.txt
CRC_Tst/db/CRC_Prj.map.bpm
CRC_Tst/db/CRC_Prj.map.cdb
CRC_Tst/db/CRC_Prj.map.ecobp
CRC_Tst/db/CRC_Prj.map.hdb
CRC_Tst/db/CRC_Prj.map.kpt
CRC_Tst/db/CRC_Prj.map.logdb
CRC_Tst/db/CRC_Prj.map.qmsg
CRC_Tst/db/CRC_Prj.map_bb.cdb
CRC_Tst/db/CRC_Prj.map_bb.hdb
CRC_Tst/db/CRC_Prj.map_bb.logdb
CRC_Tst/db/CRC_Prj.pre_map.cdb
CRC_Tst/db/CRC_Prj.pre_map.hdb
CRC_Tst/db/CRC_Prj.rpp.qmsg
CRC_Tst/db/CRC_Prj.rtlv.hdb
CRC_Tst/db/CRC_Prj.rtlv_sg.cdb
CRC_Tst/db/CRC_Prj.rtlv_sg_swap.cdb
CRC_Tst/db/CRC_Prj.sgate.rvd
CRC_Tst/db/CRC_Prj.sgate_sm.rvd
CRC_Tst/db/CRC_Prj.sgdiff.cdb
CRC_Tst/db/CRC_Prj.sgdiff.hdb
CRC_Tst/db/CRC_Prj.sld_design_entry.sci
CRC_Tst/db/CRC_Prj.sld_design_entry_dsc.sci
CRC_Tst/db/CRC_Prj.syn_hier_info
CRC_Tst/db/CRC_Prj.tan.qmsg
CRC_Tst/db/CRC_Prj.tis_db_list.ddb
CRC_Tst/db/CRC_Prj.tmw_info
CRC_Tst/db/CRC_Prj_global_asgn_op.abo
CRC_Tst/db/prev_cmp_CRC_Prj.asm.qmsg
CRC_Tst/db/prev_cmp_CRC_Prj.eda.qmsg
CRC_Tst/db/prev_cmp_CRC_Prj.fit.qmsg
CRC_Tst/db/prev_cmp_CRC_Prj.map.qmsg
CRC_Tst/db/prev_cmp_CRC_Prj.qmsg
CRC_Tst/db/prev_cmp_CRC_Prj.tan.qmsg
CRC_Tst/fasong.v
CRC_Tst/fasong.v.bak
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.atm
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.dfp
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.hdbx
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.kpt
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.logdb
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.cmp.rcf
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.map.atm
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.map.dpi
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.map.hdbx
CRC_Tst/incremental_db/compiled_partitions/CRC_Prj.root_partition.map.kpt
CRC_Tst/incremental_db/README
CRC_Tst/jieshou.v
CRC_Tst/jieshou.v.bak
CRC_Tst/simulation/modelsim/CRC_Prj.sft
CRC_Tst/simulation/modelsim/CRC_Prj.vo
CRC_Tst/simulation/modelsim/CRC_Prj.vt
CRC_Tst/simulation/modelsim/CRC_Prj_modelsim.xrf
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak1
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak2
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak3
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak4
CRC_Tst/simulation/modelsim/CRC_Prj_run_msim_rtl_verilog.do.bak5
CRC_Tst/simulation/modelsim/CRC_Prj_v.sdo
CRC_Tst/simulation/modelsim/modelsim.ini
CRC_Tst/simulation/modelsim/msim_transcript
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj/verilog.asm
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj/_primary.dat
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj/_primary.vhd
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj_vlg_tst/verilog.asm
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj_vlg_tst/_primary.dat
CRC_Tst/simulation/modelsim/rtl_work/@c@r@c_@prj_vlg_tst/_primary.vhd
CRC_Tst/simulation/modelsim/rtl_work/fasong/verilog.asm
CRC_Tst/simulation/modelsim/rtl_work/fasong/_primary.dat
CRC_Tst/simulation/modelsim/rtl_work/fasong/_primary.vhd
CRC_Tst/simulation/modelsim/rtl_work/jieshou/verilog.asm
CRC_Tst/simulation/modelsim/rtl_work/jieshou/_primary.dat
CRC_Tst/simulation/modelsim/rtl_work/jieshou/_primary.vhd
CRC_Tst/simulation/modelsim/rtl_work/_info
CRC_Tst/simulation/modelsim/verilog_libs/altera_mf_ver/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/verilog.asm
CRC_Tst/simulation/modelsim/verilog_libs/altera_mf_ver/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.dat
CRC_Tst/simulation/modelsim/verilog_libs/altera_mf_ver/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.vhd
CRC_Tst/simulation/modelsim/

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