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文件名称:lab1

  • 所属分类：
    Compress-Decompress algrithms
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-12-10
  • 文件大小：
    273.07kb
  • 已下载：
    0次
  • 提 供 者：
    kaod****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用内部时钟实现24位计数的功能，10进制，无分频，verilog语言编写-The use of the internal clock function 24 counts, 10-band, no division, verilog language
(系统自动生成,下载前可以参看下载内容)

下载文件列表

4-10/
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4-10/4-10.map.smsg
4-10/4-10.map.summary
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4-10/db/4-10.(1).cnf.hdb
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4-10/db/4-10.sgdiff.hdb
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4-10/incremental_db/README

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