文件名称:verilog
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把32位的数据转换成8位数据输出,用做fpga把数据传给dsp处理-The 32-bit data into 8 bits of data output
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/ my_first_fpga/db/my_first_fpga_top.eco.cdb
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/ my_first_fpga/db/my_first_fpga_top.sld_design_entry.sci
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/ my_first_fpga/my_first_fpga.qpf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/ my_first_fpga/my_first_fpga.qws
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/add_sub_gub.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/altsyncram_9pf1.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/alt_synch_pipe_oc8.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/alt_synch_pipe_pc8.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/a_fefifo_ctc.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/a_fefifo_htc.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/a_gray2bin_q4b.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/a_graycounter_u06.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/cntr_cta.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/dcfifo_mmc1.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/dffpipe_gd9.tdf
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/dpram_jvr.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.(0).cnf.cdb
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.(1).cnf.cdb
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.(2).cnf.cdb
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.(3).cnf.cdb
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.(4).cnf.cdb
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.asm.qmsg
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.cbx.xml
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.hif
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.signalprobe.cdb
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sim.cvwf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sld_design_entry.sci
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sl
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/ my_first_fpga/my_first_fpga.qpf
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/add_sub_gub.tdf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/altsyncram_9pf1.tdf
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使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sim.cvwf
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sld_design_entry.sci
使用verilog以及VHDL编写的将串口数据转换为32位并口数据/serial ports2/db/serialports.sl
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