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文件名称:qiangdaqi

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2014-03-13
  • 文件大小：
    1.04kb
  • 已下载：
    0次
  • 提 供 者：
    林***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
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别用迅雷、360浏览器下载。
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于verilog语言的六路抢答器设计代码，编译环境为quartus9.0，自己的一个课程设计，测试可用-Based on the six-way Responder design code verilog language compiler environment quartus9.0, one of their own curriculum design, test available
(系统自动生成,下载前可以参看下载内容)

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