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文件名称:DE2_70_NET_UART_DMA

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [MacOS] [C/C++] [源码]
  • 上传时间：
    2014-07-21
  • 文件大小：
    22.83mb
  • 已下载：
    0次
  • 提 供 者：
    黄****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

采用NIOS编写c代码实现dma传输，加入dma9000网络传输功能-Write c code using NIOS dma transfer, adding dma9000 network transmission function
(系统自动生成,下载前可以参看下载内容)

下载文件列表

DE2_70_NET_UART_DMA/.metadata/.lock
DE2_70_NET_UART_DMA/.metadata/.log
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.cdt.core/.log
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.cdt.core/altera.components.1401371274796.pdom
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.cdt.make.core/specs.c
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.cdt.make.core/specs.cpp
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.cdt.make.ui/dialog_settings.xml
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.projects/altera.components/.indexes/properties.index
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.root/.indexes/history.version
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.root/.indexes/properties.index
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.root/.indexes/properties.version
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.root/2.tree
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.resources/.safetable/org.eclipse.core.resources
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.runtime/.settings/org.eclipse.cdt.debug.core.prefs
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.runtime/.settings/org.eclipse.cdt.ui.prefs
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.runtime/.settings/org.eclipse.core.resources.prefs
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.runtime/.settings/org.eclipse.ui.ide.prefs
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.core.runtime/.settings/org.eclipse.ui.prefs
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.ui.ide/dialog_settings.xml
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.ui.workbench/dialog_settings.xml
DE2_70_NET_UART_DMA/.metadata/.plugins/org.eclipse.ui.workbench/workbench.xml
DE2_70_NET_UART_DMA/.metadata/version.ini
DE2_70_NET_UART_DMA/.sopc_builder/filters.xml
DE2_70_NET_UART_DMA/.sopc_builder/install.ptf
DE2_70_NET_UART_DMA/.sopc_builder/install2.ptf
DE2_70_NET_UART_DMA/.sopc_builder/preferences.xml
DE2_70_NET_UART_DMA/altera.components/.cdtproject
DE2_70_NET_UART_DMA/altera.components/.project
DE2_70_NET_UART_DMA/altera.components/.settings/org.eclipse.cdt.core.prefs
DE2_70_NET_UART_DMA/Altera_UP_Avalon_PS2.v
DE2_70_NET_UART_DMA/Altera_UP_PS2.v
DE2_70_NET_UART_DMA/Altera_UP_PS2_Command_Out.v
DE2_70_NET_UART_DMA/Altera_UP_PS2_Data_In.v
DE2_70_NET_UART_DMA/altpllpll.ppf
DE2_70_NET_UART_DMA/altpllpll.qip
DE2_70_NET_UART_DMA/altpllpll.v
DE2_70_NET_UART_DMA/AUDIO.v
DE2_70_NET_UART_DMA/clock_0.v
DE2_70_NET_UART_DMA/clock_1.v
DE2_70_NET_UART_DMA/cpu.ocp
DE2_70_NET_UART_DMA/cpu.sdc
DE2_70_NET_UART_DMA/cpu.v
DE2_70_NET_UART_DMA/cpu_bht_ram.mif
DE2_70_NET_UART_DMA/cpu_dc_tag_ram.mif
DE2_70_NET_UART_DMA/cpu_ic_tag_ram.mif
DE2_70_NET_UART_DMA/cpu_jtag_debug_module.v
DE2_70_NET_UART_DMA/cpu_jtag_debug_module_sysclk.v
DE2_70_NET_UART_DMA/cpu_jtag_debug_module_tck.v
DE2_70_NET_UART_DMA/cpu_jtag_debug_module_wrapper.v
DE2_70_NET_UART_DMA/cpu_mult_cell.v
DE2_70_NET_UART_DMA/cpu_ociram_default_contents.mif
DE2_70_NET_UART_DMA/cpu_oci_test_bench.v
DE2_70_NET_UART_DMA/cpu_rf_ram_a.mif
DE2_70_NET_UART_DMA/cpu_rf_ram_b.mif
DE2_70_NET_UART_DMA/cpu_test_bench.v
DE2_70_NET_UART_DMA/db/altsyncram_29f1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_3jb1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_41g1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_60q1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_9ku.tdf
DE2_70_NET_UART_DMA/db/altsyncram_9tl1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_9vc1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_e502.tdf
DE2_70_NET_UART_DMA/db/altsyncram_lg91.tdf
DE2_70_NET_UART_DMA/db/altsyncram_p132.tdf
DE2_70_NET_UART_DMA/db/altsyncram_p2f1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_p9f1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_pkf1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_q2f1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_qed1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_r4q1.tdf
DE2_70_NET_UART_DMA/db/altsyncram_t072.tdf
DE2_70_NET_UART_DMA/db/altsyncram_upv1.tdf
DE2_70_NET_UART_DMA/db/alt_synch_pipe_jcb.tdf
DE2_70_NET_UART_DMA/db/alt_synch_pipe_nc8.tdf
DE2_70_NET_UART_DMA/db/a_dpfifo_8t21.tdf
DE2_70_NET_UART_DMA/db/a_fefifo_7cf.tdf
DE2_70_NET_UART_DMA/db/a_graycounter_6fc.tdf
DE2_70_NET_UART_DMA/db/a_graycounter_7fc.tdf
DE2_70_NET_UART_DMA/db/a_graycounter_g86.tdf
DE2_70_NET_UART_DMA/db/cmpr_o16.tdf
DE2_70_NET_UART_DMA/db/cmpr_p16.tdf
DE2_70_NET_UART_DMA/db/cntr_fjb.tdf
DE2_70_NET_UART_DMA/db/cntr_rj7.tdf
DE2_70_NET_UART_DMA/db/dcfifo_6uj1.tdf
DE2_70_NET_UART_DMA/db/DE2_70_NET.(0).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(0).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(1).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(1).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(10).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(10).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(100).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(100).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(101).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(101).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(102).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(102).cnf.hdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(103).cnf.cdb
DE2_70_NET_UART_DMA/db/DE2_70_NET.(103).

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