文件名称:myfpga
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- 上传时间：2014-11-06
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详细描述设计过程
① 指令格式设计
② 微操作的定义
③ 节拍的划分
④ 处理器详细结构设计框图及功能描述(评分重点)
a. 模块之间的连线单线用细线，2根及以上用粗线并标出根数及.
b. 用箭头标明数据流向,例化时用到的信号名称应标在连线上
⑤ 各功能模块结构设计框图及功能描述（评分重点）
⑥ VHDL代码、UCF文件、测试指令序列（每条指令的含义）
⑦ 实验总结，在调试和下载过程中遇到的问题
-Design Process Design ② ① instruction format defined micro-operation ③ ④ processor division beat a detailed descr iption of the structural design and function block diagram (score focus) a detailed descr iption single wire connection between modules with thin lines, 2 and above with crude line and mark the number and. b. Use the arrow indicating the flow of data, signal names used in cases of functional modules shall be marked ⑤ structural design diagram and functional descr iption (score focus) ⑥ VHDL code on connection, UCF file test instruction sequence (the meaning of each instruction) ⑦ experiments summarized in debugging and downloading problems encountered in the process
① 指令格式设计
② 微操作的定义
③ 节拍的划分
④ 处理器详细结构设计框图及功能描述(评分重点)
a. 模块之间的连线单线用细线，2根及以上用粗线并标出根数及.
b. 用箭头标明数据流向,例化时用到的信号名称应标在连线上
⑤ 各功能模块结构设计框图及功能描述（评分重点）
⑥ VHDL代码、UCF文件、测试指令序列（每条指令的含义）
⑦ 实验总结，在调试和下载过程中遇到的问题
-Design Process Design ② ① instruction format defined micro-operation ③ ④ processor division beat a detailed descr iption of the structural design and function block diagram (score focus) a detailed descr iption single wire connection between modules with thin lines, 2 and above with crude line and mark the number and. b. Use the arrow indicating the flow of data, signal names used in cases of functional modules shall be marked ⑤ structural design diagram and functional descr iption (score focus) ⑥ VHDL code on connection, UCF file test instruction sequence (the meaning of each instruction) ⑦ experiments summarized in debugging and downloading problems encountered in the process
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myfpga/MCPU/MALU.vhd
myfpga/MCPU/MBACK.vhd
myfpga/MCPU/MCLK.vhd
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myfpga/MCPU/MyBACK.tbw
myfpga/MCPU/MyCLK.jhd
myfpga/MCPU/MyCLK.tbw
myfpga/MCPU/MyCPU.jhd
myfpga/MCPU/MyCPU.tbw
myfpga/MCPU/MyCTRL.jhd
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myfpga/MCPU/MyGETIR.jhd
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