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文件名称:fifo

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2014-11-13
  • 文件大小：
    10.36mb
  • 已下载：
    0次
  • 提 供 者：
    金****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于FPGA的fifo例程及仿真测试文件。-Fifo FPGA-based emulation routines and test files.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

fifo/
fifo/core/
fifo/dev/
fifo/doc/
fifo/sim/
fifo/src/
fifo/src/220model.v
fifo/src/altera_mf.v
fifo/src/db/
fifo/src/db/fifo.(0).cnf.cdb
fifo/src/db/fifo.(0).cnf.hdb
fifo/src/db/fifo.(1).cnf.cdb
fifo/src/db/fifo.(1).cnf.hdb
fifo/src/db/fifo.(2).cnf.cdb
fifo/src/db/fifo.(2).cnf.hdb
fifo/src/db/fifo.(3).cnf.cdb
fifo/src/db/fifo.(3).cnf.hdb
fifo/src/db/fifo.cbx.xml
fifo/src/db/fifo.cmp.rdb
fifo/src/db/fifo.db_info
fifo/src/db/fifo.hier_info
fifo/src/db/fifo.hif
fifo/src/db/fifo.ipinfo
fifo/src/db/fifo.lpc.html
fifo/src/db/fifo.lpc.rdb
fifo/src/db/fifo.lpc.txt
fifo/src/db/fifo.map.qmsg
fifo/src/db/fifo.map.rdb
fifo/src/db/fifo.map_bb.hdb
fifo/src/db/fifo.pre_map.hdb
fifo/src/db/fifo.pti_db_list.ddb
fifo/src/db/fifo.rtlv.hdb
fifo/src/db/fifo.rtlv_sg.cdb
fifo/src/db/fifo.rtlv_sg_swap.cdb
fifo/src/db/fifo.sld_design_entry.sci
fifo/src/db/fifo.sld_design_entry_dsc.sci
fifo/src/db/fifo.smart_action.txt
fifo/src/db/fifo.tis_db_list.ddb
fifo/src/db/logic_util_heursitic.dat
fifo/src/db/mypll_altpll.v
fifo/src/db/prev_cmp_fifo.qmsg
fifo/src/fifo.cr.mti
fifo/src/fifo.mpf
fifo/src/fifo.qpf
fifo/src/fifo.qsf
fifo/src/fifo.qws
fifo/src/fifo_nativelink_simulation.rpt
fifo/src/fifo_tb.v
fifo/src/fifo_tb.v.bak
fifo/src/greybox_tmp/
fifo/src/greybox_tmp/cbx_args.txt
fifo/src/incremental_db/
fifo/src/incremental_db/README
fifo/src/incremental_db/compiled_partitions/
fifo/src/incremental_db/compiled_partitions/fifo.db_info
fifo/src/incremental_db/compiled_partitions/fifo.root_partition.map.dpi.tmp
fifo/src/modelsim.ini
fifo/src/myfifo.qip
fifo/src/myfifo.v
fifo/src/mypll.ppf
fifo/src/mypll.qip
fifo/src/mypll.v
fifo/src/mypll_inst.v
fifo/src/mypll_tb.v
fifo/src/mypll_tb.v.bak
fifo/src/output_files/
fifo/src/output_files/fifo.flow.rpt
fifo/src/output_files/fifo.map.rpt
fifo/src/output_files/fifo.map.summary
fifo/src/pll_tb.cr.mti
fifo/src/pll_tb.mpf
fifo/src/vsim.wlf
fifo/src/wlft6yjavg
fifo/src/wlftyxbcxt
fifo/src/work/
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.dat
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.dbs
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.vhd
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/verilog.prw
fifo/src/work/@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/verilog.psm
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/_primary.dat
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/_primary.dbs
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/_primary.vhd
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/verilog.prw
fifo/src/work/@a@l@t@e@r@a_@m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n/verilog.psm
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fifo/src/work/@a@l@t@e@r@a_@m@f_@m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n/_primary.dat
fifo/src/work/@a@l@t@e@r@a_@m@f_@m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n/_primary.dbs
fifo/src/work/@a@l@t@e@r@a_@m@f_@m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n/_primary.vhd
fifo/src/work/@a@l@t@e@r@a_@m@f_@m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n/verilog.prw
fifo/src/work/@a@l@t@e@r@a_@m@f_@m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n/verilog.psm
fifo/src/work/@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/
fifo/src/work/@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.dat
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fifo/src/work/@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s/_primary.vhd
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fifo/src/work/@m@f_cycloneiii_pll/verilog.psm
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fifo/src/work/@m@f_cycloneiiigl_m_cntr/verilog.prw
fifo/src/work/@m@f_cycloneiiigl_m_cntr/verilog.psm
fifo/src/work/@m@f_cycloneiiigl_n_cntr/
fifo/src/work/@m@f_cycloneiiigl_n_cntr/_primary.d

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