文件名称:4weizhucijinweijiafaqi_verilog
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- 上传时间：2014-12-10
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四位逐次进位加法器的verilog实现。附tb.v文件。单片机开发，数字逻辑与处理器基础实验-Four successive carry adder verilog implementation. Tb.v attached file. SCM development, digital logic and processor basic experiment
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Adder_4bits.v
Adder_4bits_tb.v
Adder_4bits_tb.v
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