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文件名称:Uvm_mem_example

  • 所属分类：
    Other systems
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2014-12-21
  • 文件大小：
    304.12kb
  • 已下载：
    1次
  • 提 供 者：
    段****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

uvm example about memory
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Uvm_mem_example/mem_example/agents/ahb_agent/ahb_agent.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_agent_config.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_agent_pkg.sv
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_driver.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_if.sv
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_monitor.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_read_seq.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_seq.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_sequencer.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_seq_item.svh
Uvm_mem_example/mem_example/agents/ahb_agent/ahb_write_seq.svh
Uvm_mem_example/mem_example/agents/ahb_agent/reg2ahb_adapter.svh
Uvm_mem_example/mem_example/dut/mem_ss.sv
Uvm_mem_example/mem_example/dut/mem_ss_wrapper.sv
Uvm_mem_example/mem_example/dut/reg_defs.sv
Uvm_mem_example/mem_example/env/mem_ss_env.svh
Uvm_mem_example/mem_example/env/mem_ss_env_config.svh
Uvm_mem_example/mem_example/env/mem_ss_env_pkg.sv
Uvm_mem_example/mem_example/register_model/mem_ss_reg_pkg.sv
Uvm_mem_example/mem_example/sequences/mem_ss_seq_lib_pkg.sv
Uvm_mem_example/mem_example/sim/Makefile
Uvm_mem_example/mem_example/sim/Makefile-modelsim
Uvm_mem_example/mem_example/sim/Makefile-modelsim.bak
Uvm_mem_example/mem_example/sim/README.txt
Uvm_mem_example/mem_example/sim/vsim.wlf
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg/verilog.asm
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg/verilog.rw
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg/_primary.dat
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg/_primary.dbs
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg/_primary.vhd
Uvm_mem_example/mem_example/sim/work/ahb_if/verilog.asm
Uvm_mem_example/mem_example/sim/work/ahb_if/verilog.rw
Uvm_mem_example/mem_example/sim/work/ahb_if/_primary.dat
Uvm_mem_example/mem_example/sim/work/ahb_if/_primary.dbs
Uvm_mem_example/mem_example/sim/work/ahb_if/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg/_primary.vhd
Uvm_mem_example/mem_example/sim/work/mem_ss_wrapper/verilog.asm
Uvm_mem_example/mem_example/sim/work/mem_ss_wrapper/verilog.rw
Uvm_mem_example/mem_example/sim/work/mem_ss_wrapper/_primary.dat
Uvm_mem_example/mem_example/sim/work/mem_ss_wrapper/_primary.dbs
Uvm_mem_example/mem_example/sim/work/mem_ss_wrapper/_primary.vhd
Uvm_mem_example/mem_example/sim/work/top_tb/verilog.asm
Uvm_mem_example/mem_example/sim/work/top_tb/verilog.rw
Uvm_mem_example/mem_example/sim/work/top_tb/_primary.dat
Uvm_mem_example/mem_example/sim/work/top_tb/_primary.dbs
Uvm_mem_example/mem_example/sim/work/top_tb/_primary.vhd
Uvm_mem_example/mem_example/sim/work/_dpi/dpi.tfdb
Uvm_mem_example/mem_example/sim/work/_info
Uvm_mem_example/mem_example/sim/work/_temp/vlog130gym
Uvm_mem_example/mem_example/sim/work/_temp/vlog829kqx
Uvm_mem_example/mem_example/sim/work/_temp/vlogf5crct
Uvm_mem_example/mem_example/sim/work/_temp/vloghh6xk9
Uvm_mem_example/mem_example/sim/work/_temp/vlogt6fvar
Uvm_mem_example/mem_example/sim/work/_vmake
Uvm_mem_example/mem_example/tb/top_tb.sv
Uvm_mem_example/mem_example/test/mem_ss_test.svh
Uvm_mem_example/mem_example/test/mem_ss_test_lib_pkg.sv
Uvm_mem_example/mem_example/sim/work/ahb_agent_pkg
Uvm_mem_example/mem_example/sim/work/ahb_if
Uvm_mem_example/mem_example/sim/work/mem_ss
Uvm_mem_example/mem_example/sim/work/mem_ss_env_pkg
Uvm_mem_example/mem_example/sim/work/mem_ss_reg_pkg
Uvm_mem_example/mem_example/sim/work/mem_ss_seq_lib_pkg
Uvm_mem_example/mem_example/sim/work/mem_ss_test_lib_pkg
Uvm_mem_example/mem_

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