文件名称:AD80305
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一种基于xilinx FPGA S6,verilog 实现AD80305输入输出接口配置，可参考-Based xilinx FPGA S6, verilog realize AD80305 input and output interface configuration, refer to
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AD80305/
AD80305/AD80305_DATA_INTF_RX_DCS.v
AD80305/AD80305_DATA_INTF_TX_DCS.v
AD80305/AD80305_DATA_INTF_RX_DCS.v
AD80305/AD80305_DATA_INTF_TX_DCS.v
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