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文件名称:uart_8

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2015-01-13
  • 文件大小：
    1.6kb
  • 已下载：
    0次
  • 提 供 者：
    MR_s****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog描述的串口通信接口，主体为接收机和发送机两个模块-Serial communication interface with Verilog descr iption, subject to a receiver and transmitter module two


(系统自动生成,下载前可以参看下载内容)

下载文件列表

课设—串口通信_[已验证].txt

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