文件名称:MIPS
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- 上传时间：2015-03-30
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用verilog编写的简单的类MIPS多周期流水化处理器实现，基本功能包括9条指令和两位动态分支预测，压缩包里的word详细说明了结构中的细节-Written by verilog simple class multi-cycle pipelined MIPS processor, the basic features include 9 instruction and two dynamic branch prediction, compressed bag word specifies the details of the structure
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计算机组成实验报告.docx
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modelsim仿真代码/branch_table.v
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modelsim仿真代码/EX.v
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modelsim仿真代码/mips.v
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modelsim仿真代码/reg_file.v
modelsim仿真代码/reg_stage.v
modelsim仿真代码/WB.v
modelsim仿真代码
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modelsim仿真代码/ID.v
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modelsim仿真代码/MEM.v
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modelsim仿真代码/mips_constant.v
modelsim仿真代码/mips_tb.v
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