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文件名称:Verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2015-06-15
  • 文件大小：
    12.07mb
  • 已下载：
    0次
  • 提 供 者：
    595***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

FPGA开发板资料Verilog，53个例程-fpga Development board materia
(系统自动生成,下载前可以参看下载内容)

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Verilog/
Verilog/Verilog程序/
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/db/
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/db/key_led.(0).cnf.cdb
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/db/key_led.(0).cnf.hdb
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Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led.sof
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led.tan.rpt
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led.tan.summary
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led.v
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led.v.bak
Verilog/Verilog程序/10实验十：利用语言实现按键和数码管显示/key_led_assignment_defaults.qdf
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/.xhdl3.xref
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/cmp_state.ini
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/db/
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/db/mlt.(0).cnf.cdb
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/db/mlt.(0).cnf.hdb
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/db/mlt.asm.qmsg
Verilog/Verilog程序/11实验十一：利用语言实现乘法器数码管显示/db/mlt.asm_labs.ddb
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Verilog/Veri

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