文件名称:VHDL_Multiplier
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所属分类：
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- 上传时间：2015-07-10
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文件大小：4.97kb
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三种 VHDL 实现乘法器的方法，可以用于学习FPGA的时序、组合电路，同时附带了 TestBench 程序-Three kinds of methods to achieve multiplier in VHDL, with TestBench
(系统自动生成,下载前可以参看下载内容)
下载文件列表
MultiplyA.vhd
MultiplyB.vhd
MultiplyC.vhd
MultiTestA.vhd
MultiTestB.vhd
MultiTestC.vhd
MultiplyB.vhd
MultiplyC.vhd
MultiTestA.vhd
MultiTestB.vhd
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