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文件名称:RSdecoder

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2015-09-07
  • 文件大小：
    11.4kb
  • 已下载：
    0次
  • 提 供 者：
    opu****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

自己写的基于verilog的RS译码器，能够实现RS(240，224)码译码，一级流水设计，可连续译码也可非连续译码。-RSdecoder for RS(240,224).
(系统自动生成,下载前可以参看下载内容)

下载文件列表

RSdecoder/chein.v
RSdecoder/mutiplyx.v
RSdecoder/riBM.v
RSdecoder/rom_inv.v
RSdecoder/rs_decoder.v
RSdecoder/shift_taps.v
RSdecoder/syn-d.v
RSdecoder

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