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文件名称:VHDL-Gray-code

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2015-10-15
  • 文件大小：
    91.35kb
  • 已下载：
    2次
  • 提 供 者：
    谢****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于vhdl格雷码设计代码，调试过没错误。-Gray code design based on VHDL code, debugging didn t mistake.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

基于VHDL格雷码编码器的设计/exp2.asm.rpt
基于VHDL格雷码编码器的设计/exp2.done
基于VHDL格雷码编码器的设计/exp2.eda.rpt
基于VHDL格雷码编码器的设计/exp2.fit.rpt
基于VHDL格雷码编码器的设计/exp2.fit.smsg
基于VHDL格雷码编码器的设计/exp2.fit.summary
基于VHDL格雷码编码器的设计/exp2.flow.rpt
基于VHDL格雷码编码器的设计/exp2.map.rpt
基于VHDL格雷码编码器的设计/exp2.map.summary
基于VHDL格雷码编码器的设计/exp2.pin
基于VHDL格雷码编码器的设计/exp2.qpf
基于VHDL格雷码编码器的设计/exp2.qsf
基于VHDL格雷码编码器的设计/exp2.qws
基于VHDL格雷码编码器的设计/exp2.sof
基于VHDL格雷码编码器的设计/exp2.sta.rpt
基于VHDL格雷码编码器的设计/exp2.sta.summary
基于VHDL格雷码编码器的设计/exp2.vhd
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.cmp.atm
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.cmp.dfp
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.cmp.hdbx
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.cmp.kpt
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.cmp.rcf
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.map.atm
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.map.dpi
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.map.hdbx
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions/exp2.root_partition.map.kpt
基于VHDL格雷码编码器的设计/incremental_db/README
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2.sft
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2.vho
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2_8_1200mv_0c_vhd_slow.sdo
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2_8_1200mv_85c_vhd_slow.sdo
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2_min_1200mv_0c_vhd_fast.sdo
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2_modelsim.xrf
基于VHDL格雷码编码器的设计/simulation/modelsim/exp2_vhd.sdo
基于VHDL格雷码编码器的设计/timing/primetime/exp2.collections.sdc
基于VHDL格雷码编码器的设计/timing/primetime/exp2.constraints.sdc
基于VHDL格雷码编码器的设计/timing/primetime/exp2.pt.tcl
基于VHDL格雷码编码器的设计/timing/primetime/exp2.vo
基于VHDL格雷码编码器的设计/timing/primetime/exp2_8_1200mv_0c_v_slow.sdo
基于VHDL格雷码编码器的设计/timing/primetime/exp2_8_1200mv_85c_v_slow.sdo
基于VHDL格雷码编码器的设计/timing/primetime/exp2_min_1200mv_0c_v_fast.sdo
基于VHDL格雷码编码器的设计/timing/primetime/exp2_v.sdo
基于VHDL格雷码编码器的设计/incremental_db/compiled_partitions
基于VHDL格雷码编码器的设计/simulation/modelsim
基于VHDL格雷码编码器的设计/timing/primetime
基于VHDL格雷码编码器的设计/db
基于VHDL格雷码编码器的设计/incremental_db
基于VHDL格雷码编码器的设计/simulation
基于VHDL格雷码编码器的设计/timing
基于VHDL格雷码编码器的设计

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