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文件名称:i2s_input

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2015-10-30
  • 文件大小：
    39.13kb
  • 已下载：
    0次
  • 提 供 者：
    y*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于FPGA的i2s接口输入模块设计，其中有原理图和verilog源码，可在Quartus环境下进行仿真-FPGA-based i2s interface input module design, including schematics and verilog source code, can be simulated in Quartus environment
(系统自动生成,下载前可以参看下载内容)

下载文件列表

i2s_input.td
i2s_input.v
i2s_input模块设计说明.doc

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