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文件名称:使用VHDL语言设计数字钟

  • 所属分类：
    VHDL编程
  • 标签属性：
    [Text]
  • 上传时间：
    2008-10-13
  • 文件大小：
    1.59kb
  • 已下载：
    1次
  • 提 供 者：
    woxi****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本文所设计的数字钟具有通过reset键对时、 分、 秒调整功能.该设计分为六个部分： 六进制计数器 counter6，十进制计数器 counter10 ，二四进制计数器 counter24， 时钟模块 bclock， LED扫描显示模块 ledctrl。设计使用VHDL 语言，
(系统自动生成,下载前可以参看下载内容)

下载文件列表

33.txt

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