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文件名称:VHDLdesign
介绍说明--下载内容来自于网络,使用问题请自行百度
EDA课程设计,包含源码和文档说明,实现秒表计数和闹钟功能,使用VHDL语言编写
已完成功能
1. 完成时/分/秒的依次显示并正确计数,利用六位数码管显示;
2. 时/分/秒各段个位满10正确进位,秒/分能做到满60向前进位,有系统时间清零功能;
3. 定时器:实现整点报时,通过扬声器发出高低报时声音;
4. 时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整;
5. 闹钟:实现分/时闹钟设置,在时钟到达设定时间时通过扬声器响铃。有静音模式。
待改进功能:
1. 系统没有万年历功能,正在思考设计方法。
2. 应添加秒表功能。
已完成功能
1. 完成时/分/秒的依次显示并正确计数,利用六位数码管显示;
2. 时/分/秒各段个位满10正确进位,秒/分能做到满60向前进位,有系统时间清零功能;
3. 定时器:实现整点报时,通过扬声器发出高低报时声音;
4. 时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整;
5. 闹钟:实现分/时闹钟设置,在时钟到达设定时间时通过扬声器响铃。有静音模式。
待改进功能:
1. 系统没有万年历功能,正在思考设计方法。
2. 应添加秒表功能。
(系统自动生成,下载前可以参看下载内容)
下载文件列表
VHDLdesign/clk.acf
VHDLdesign/clk.scf
VHDLdesign/clk.vhd
VHDLdesign/设计报告.doc
VHDLdesign
www.dssz.com.txt
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