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文件名称:vhdl416yima.doc

  • 所属分类：
    VHDL编程
  • 标签属性：
    [WORD]
  • 上传时间：
    2016-04-09
  • 文件大小：
    2.4kb
  • 已下载：
    0次
  • 提 供 者：
    小***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

四十六译码器 是用if语句描述的-library IEEE

use IEEE.std_logic_1164.all

entity encoder4_16 is

port ( d: in STD_LOGIC_VECTOR (3downto0)

q: out STD_LOGIC_VECTOR (15downto0))

end encoder4_16

architecture encoder_if of encoder4_16 is

begin

process(d)

begin

if d= 0000　
(系统自动生成,下载前可以参看下载内容)

下载文件列表

vhdl416yima.doc

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