文件名称:uart_verilog
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串口逻辑的verilog实现，输入可以为字节、双字、四字-verilog code for uart
(系统自动生成,下载前可以参看下载内容)
下载文件列表
uart/
uart/rx/
uart/rx/stop_timer.v
uart/rx/uart_rx_byte.v
uart/rx/uart_rx_ctrl.v
uart/rx/uart_rx_dword.v
uart/rx/uart_rx_timer.v
uart/tx/
uart/tx/tx_dat_gen.v
uart/tx/tx_stop_timer.v
uart/tx/uart_timer.v
uart/tx/uart_tx_byte.v
uart/tx/uart_tx_ctrl.v
uart/tx/uart_tx_dword.v
uart/rx/
uart/rx/stop_timer.v
uart/rx/uart_rx_byte.v
uart/rx/uart_rx_ctrl.v
uart/rx/uart_rx_dword.v
uart/rx/uart_rx_timer.v
uart/tx/
uart/tx/tx_dat_gen.v
uart/tx/tx_stop_timer.v
uart/tx/uart_timer.v
uart/tx/uart_tx_byte.v
uart/tx/uart_tx_ctrl.v
uart/tx/uart_tx_dword.v
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