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文件名称:ethernet_verilog

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2017-02-06
  • 文件大小:
    8.31mb
  • 已下载:
    0次
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1000M以太网UDP协议在FPGA的实现源码,测试通过-1000M Ethernet UDP protocol in the FPGA to achieve source, the test passed
(系统自动生成,下载前可以参看下载内容)

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ethernet_verilog/
ethernet_verilog/11.wcfg
ethernet_verilog/_impact.cmd
ethernet_verilog/_impact.log
ethernet_verilog/_ngo/
ethernet_verilog/_ngo/cs_icon_pro/
ethernet_verilog/_ngo/cs_icon_pro/_xmsgs/
ethernet_verilog/_ngo/cs_icon_pro/_xmsgs/xst.xmsgs
ethernet_verilog/_ngo/cs_icon_pro/coregen.cgc
ethernet_verilog/_ngo/cs_icon_pro/coregen.cgp
ethernet_verilog/_ngo/cs_icon_pro/coregen.log
ethernet_verilog/_ngo/cs_icon_pro/generate_icon_pro.xco
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.gise
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.ucf
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.vhd
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.vho
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.xco
ethernet_verilog/_ngo/cs_icon_pro/icon_pro.xise
ethernet_verilog/_ngo/cs_icon_pro/icon_pro_flist.txt
ethernet_verilog/_ngo/cs_icon_pro/icon_pro_readme.txt
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ethernet_verilog/_ngo/ethernet_cs_signalbrowser.ver
ethernet_verilog/_ngo/ethernet_signalbrowser.ngo
ethernet_verilog/_ngo/ethernet_signalbrowser.ver
ethernet_verilog/_ngo/ethernet_test_cs_signalbrowser.ngo
ethernet_verilog/_ngo/ethernet_test_cs_signalbrowser.ver
ethernet_verilog/_ngo/icon_pro.ngc
ethernet_verilog/_ngo/ila_pro_0.ngc
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ethernet_verilog/chipscope_icon.asy
ethernet_verilog/chipscope_icon.constraints/
ethernet_verilog/chipscope_icon.constraints/chipscope_icon.ucf
ethernet_verilog/chipscope_icon.constraints/chipscope_icon.xdc
ethernet_verilog/chipscope_icon.gise
ethernet_verilog/chipscope_icon.ncf
ethernet_verilog/chipscope_icon.ngc
ethernet_verilog/chipscope_icon.ucf
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ethernet_verilog/chipscope_icon.veo
ethernet_verilog/chipscope_icon.xco
ethernet_verilog/chipscope_icon.xdc
ethernet_verilog/chipscope_icon_flist.txt
ethernet_verilog/chipscope_icon_readme.txt
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ethernet_verilog/chipscope_ila.asy
ethernet_verilog/chipscope_ila.cdc
ethernet_verilog/chipscope_ila.constraints/
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ethernet_verilog/chipscope_ila.constraints/chipscope_ila.xdc
ethernet_verilog/chipscope_ila.gise
ethernet_verilog/chipscope_ila.ncf
ethernet_verilog/chipscope_ila.ngc
ethernet_verilog/chipscope_ila.ucf
ethernet_verilog/chipscope_ila.v
ethernet_verilog/chipscope_ila.veo
ethernet_verilog/chipscope_ila.xco
ethernet_verilog/chipscope_ila.xdc
ethernet_verilog/chipscope_ila_flist.txt
ethernet_verilog/chipscope_ila_readme.txt
ethernet_verilog/chipscope_ila_xmdf.tcl
ethernet_verilog/coregen.cgc
ethernet_verilog/coregen.cgp
ethernet_verilog/ethernet.bgn
ethernet_verilog/ethernet.bld
ethernet_verilog/ethernet.cfi
ethernet_verilog/ethernet.cmd_log
ethernet_verilog/ethernet.drc
ethernet_verilog/ethernet.lso
ethernet_verilog/ethernet.mcs
ethernet_verilog/ethernet.ncd
ethernet_verilog/ethernet.ngc
ethernet_verilog/ethernet.ngd
ethernet_verilog/ethernet.ngr
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ethernet_verilog/ethernet.ptwx
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ethernet_verilog/ethernet.twx
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