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文件名称:jtag_slave.4

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-04-22
  • 文件大小：
    2.46kb
  • 已下载：
    0次
  • 提 供 者：
    scn***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

1.1 Compliant with IEEE 1149.1

1.2 Support mandatory BYPASS, SAMPLE/PRELOAD, EXTEST instructions

1.3 Support user register connection beetween TDI-TDO

1.4 Boundary-scan register consist of cell type BC_1
(系统自动生成,下载前可以参看下载内容)

下载文件列表

jtag_slave.4.v

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