文件名称:FPGA
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所属分类:
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- 上传时间:2017-05-27
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扫频功能key2level.v
按键点击一次,输出信号电平变化一次;
key2pulse.v
按键点击一次,输出信号产生一个周期的脉冲信号;-weep function key2level.v
Press the button once, the output signal level changes once
Key2pulse.v
Press the button once, the output signal to generate a cycle of the pulse signal
按键点击一次,输出信号电平变化一次;
key2pulse.v
按键点击一次,输出信号产生一个周期的脉冲信号;-weep function key2level.v
Press the button once, the output signal level changes once
Key2pulse.v
Press the button once, the output signal to generate a cycle of the pulse signal
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下载文件列表
fpga各个模块/
fpga各个模块/ADDAC/
fpga各个模块/ADDAC/ADC.v
fpga各个模块/ADDAC/DAC.v
fpga各个模块/ADDAC/ad.vwf
fpga各个模块/led.v
fpga各个模块/saopin.doc
fpga各个模块/saopin.v
fpga各个模块/saopin.vt
fpga各个模块/xiaodou.doc
fpga各个模块/xiaodou.v
fpga各个模块/xiaodou.vt
fpga各个模块/yama.doc
fpga各个模块/yima.v
fpga各个模块/yima.vt
fpga各个模块/分频模块/
fpga各个模块/分频模块/FenPin1.v
fpga各个模块/分频模块/clkGenerator.v
fpga各个模块/分频模块/clkGenerator.vt
fpga各个模块/分频模块/readme.txt
fpga各个模块/按键信号处理模块/
fpga各个模块/按键信号处理模块/key2level.v
fpga各个模块/按键信号处理模块/key2pulse.v
fpga各个模块/按键信号处理模块/readme.txt
fpga各个模块/计时模块/
fpga各个模块/计时模块/jishi.v
fpga各个模块/计时模块/jishi.vt
fpga各个模块/计时模块/readme.txt
fpga各个模块/ADDAC/
fpga各个模块/ADDAC/ADC.v
fpga各个模块/ADDAC/DAC.v
fpga各个模块/ADDAC/ad.vwf
fpga各个模块/led.v
fpga各个模块/saopin.doc
fpga各个模块/saopin.v
fpga各个模块/saopin.vt
fpga各个模块/xiaodou.doc
fpga各个模块/xiaodou.v
fpga各个模块/xiaodou.vt
fpga各个模块/yama.doc
fpga各个模块/yima.v
fpga各个模块/yima.vt
fpga各个模块/分频模块/
fpga各个模块/分频模块/FenPin1.v
fpga各个模块/分频模块/clkGenerator.v
fpga各个模块/分频模块/clkGenerator.vt
fpga各个模块/分频模块/readme.txt
fpga各个模块/按键信号处理模块/
fpga各个模块/按键信号处理模块/key2level.v
fpga各个模块/按键信号处理模块/key2pulse.v
fpga各个模块/按键信号处理模块/readme.txt
fpga各个模块/计时模块/
fpga各个模块/计时模块/jishi.v
fpga各个模块/计时模块/jishi.vt
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