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文件名称:卷积交织器解交织器设计

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2017-07-06
  • 文件大小：
    736kb
  • 已下载：
    1次
  • 提 供 者：
    一*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

交织技术通常分为分组交织和卷积交织。分组交织过程是数据先按行写入，再按列读出；解交织过程是数据先按列写入，再按行读出。其特点是结构简单，但数据延时时间长，而且所需的存储器比较大。(Interleaving techniques are usually divided into packet interleaving and convolution interleaving. Packet interleaving process is the first data written by row, and then read out by column; deinterleaving process is the first data written by the column, then read by line. It is characterized by a simple structure, but the data delay time is long, and the required memory is relatively large.)
相关搜索： 卷积交织器解交织器 vhdl 交织器

(系统自动生成,下载前可以参看下载内容)

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