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文件名称:sin

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-07-07
  • 文件大小：
    3kb
  • 已下载：
    0次
  • 提 供 者：
    BC***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

能够实现正弦波的输出以及通过频率控制字与相位控制字控制正弦波的相位与频率。(The output of the sine wave can be realized and the phase and frequency of the sine wave can be controlled by two control words.)
相关搜索： 基于verilog的DDS设计

(系统自动生成,下载前可以参看下载内容)

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DDS.v
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