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文件名称:verilog_i10Mhz

  • 所属分类：
    其他
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-07-10
  • 文件大小：
    2.95mb
  • 已下载：
    0次
  • 提 供 者：
    小黑1****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

10MHZ的频率的程序，验证过可以使用，有需要的可以下载(10MHZ frequency of the program, verify that you can use, there is a need to download)
相关搜索： verilog 1209d

(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog_i10Mhz\db\.cmp.kpt
verilog_i10Mhz\db\logic_util_heursitic.dat
verilog_i10Mhz\db\pll_ctr_altpll.v
verilog_i10Mhz\db\prev_cmp_verilog_i10Mhz.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.asm.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.asm.rdb
verilog_i10Mhz\db\verilog_i10Mhz.asm_labs.ddb
verilog_i10Mhz\db\verilog_i10Mhz.cbx.xml
verilog_i10Mhz\db\verilog_i10Mhz.cmp.bpm
verilog_i10Mhz\db\verilog_i10Mhz.cmp.cdb
verilog_i10Mhz\db\verilog_i10Mhz.cmp.hdb
verilog_i10Mhz\db\verilog_i10Mhz.cmp.idb
verilog_i10Mhz\db\verilog_i10Mhz.cmp.logdb
verilog_i10Mhz\db\verilog_i10Mhz.cmp.rdb
verilog_i10Mhz\db\verilog_i10Mhz.cmp_merge.kpt
verilog_i10Mhz\db\verilog_i10Mhz.cycloneive_io_sim_cache.45um_ff_1200mv_0c_fast.hsd
verilog_i10Mhz\db\verilog_i10Mhz.cycloneive_io_sim_cache.45um_ii_1200mv_0c_slow.hsd
verilog_i10Mhz\db\verilog_i10Mhz.cycloneive_io_sim_cache.45um_ii_1200mv_85c_slow.hsd
verilog_i10Mhz\db\verilog_i10Mhz.db_info
verilog_i10Mhz\db\verilog_i10Mhz.eda.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.fit.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.hier_info
verilog_i10Mhz\db\verilog_i10Mhz.hif
verilog_i10Mhz\db\verilog_i10Mhz.ipinfo
verilog_i10Mhz\db\verilog_i10Mhz.lpc.html
verilog_i10Mhz\db\verilog_i10Mhz.lpc.rdb
verilog_i10Mhz\db\verilog_i10Mhz.lpc.txt
verilog_i10Mhz\db\verilog_i10Mhz.map.ammdb
verilog_i10Mhz\db\verilog_i10Mhz.map.bpm
verilog_i10Mhz\db\verilog_i10Mhz.map.cdb
verilog_i10Mhz\db\verilog_i10Mhz.map.hdb
verilog_i10Mhz\db\verilog_i10Mhz.map.kpt
verilog_i10Mhz\db\verilog_i10Mhz.map.logdb
verilog_i10Mhz\db\verilog_i10Mhz.map.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.map.rdb
verilog_i10Mhz\db\verilog_i10Mhz.map_bb.cdb
verilog_i10Mhz\db\verilog_i10Mhz.map_bb.hdb
verilog_i10Mhz\db\verilog_i10Mhz.map_bb.logdb
verilog_i10Mhz\db\verilog_i10Mhz.pplq.rdb
verilog_i10Mhz\db\verilog_i10Mhz.pre_map.hdb
verilog_i10Mhz\db\verilog_i10Mhz.pti_db_list.ddb
verilog_i10Mhz\db\verilog_i10Mhz.root_partition.map.reg_db.cdb
verilog_i10Mhz\db\verilog_i10Mhz.routing.rdb
verilog_i10Mhz\db\verilog_i10Mhz.rtlv.hdb
verilog_i10Mhz\db\verilog_i10Mhz.rtlv_sg.cdb
verilog_i10Mhz\db\verilog_i10Mhz.rtlv_sg_swap.cdb
verilog_i10Mhz\db\verilog_i10Mhz.sgdiff.cdb
verilog_i10Mhz\db\verilog_i10Mhz.sgdiff.hdb
verilog_i10Mhz\db\verilog_i10Mhz.sld_design_entry.sci
verilog_i10Mhz\db\verilog_i10Mhz.sld_design_entry_dsc.sci
verilog_i10Mhz\db\verilog_i10Mhz.smart_action.txt
verilog_i10Mhz\db\verilog_i10Mhz.smp_dump.txt
verilog_i10Mhz\db\verilog_i10Mhz.sta.qmsg
verilog_i10Mhz\db\verilog_i10Mhz.sta.rdb
verilog_i10Mhz\db\verilog_i10Mhz.sta_cmp.7_slow_1200mv_85c.tdb
verilog_i10Mhz\db\verilog_i10Mhz.tiscmp.fast_1200mv_0c.ddb
verilog_i10Mhz\db\verilog_i10Mhz.tiscmp.slow_1200mv_0c.ddb
verilog_i10Mhz\db\verilog_i10Mhz.tiscmp.slow_1200mv_85c.ddb
verilog_i10Mhz\db\verilog_i10Mhz.tis_db_list.ddb
verilog_i10Mhz\db\verilog_i10Mhz.tmw_info
verilog_i10Mhz\db\verilog_i10Mhz.vpr.ammdb
verilog_i10Mhz\greybox_tmp\cbx_args.txt
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.db_info
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.ammdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.cdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.dfp
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.hdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.logdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.cmp.rcfdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.cdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.dpi
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.hbdb.cdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.hbdb.hb_info
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.hbdb.hdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.hbdb.sig
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.hdb
verilog_i10Mhz\incremental_db\compiled_partitions\verilog_i10Mhz.root_partition.map.kpt
verilog_i10Mhz\incremental_db\README
verilog_i10Mhz\output_files\verilog_i10Mhz.asm.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.done
verilog_i10Mhz\output_files\verilog_i10Mhz.eda.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.fit.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.fit.smsg
verilog_i10Mhz\output_files\verilog_i10Mhz.fit.summary
verilog_i10Mhz\output_files\verilog_i10Mhz.flow.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.jdi
verilog_i10Mhz\output_files\verilog_i10Mhz.map.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.map.smsg
verilog_i10Mhz\output_files\verilog_i10Mhz.map.summary
verilog_i10Mhz\output_files\verilog_i10Mhz.pin
verilog_i10Mhz\output_files\verilog_i10Mhz.sof
verilog_i10Mhz\output_files\verilog_i10Mhz.sta.rpt
verilog_i10Mhz\output_files\verilog_i10Mhz.sta.summary
verilog_i10Mhz\PLLJ_PLLSPE_INFO.txt
verilog_i10Mhz\pll_ctr.ppf
verilog_i10Mhz\pll_ctr.qip
verilog_i10Mhz\pll_ctr.v
verilog_i10Mhz\pll_ctr_bb.v
verilog_i10Mhz\pll_ctr_inst.v
verilog_i10Mhz\simulation\modelsim\modelsim.ini

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