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文件名称:syn_dp_fifo.v

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-07-27
  • 文件大小：
    1kb
  • 已下载：
    0次
  • 提 供 者：
    junka******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

同步双端口FIFO, 可同时读写，FIFO深度宽度可通过参数配置，带SV断言测试。(Dual Port Synchronization FIFO for ASIC/FPGA)
相关搜索： fifo Synchronization FIFO dual port

(系统自动生成,下载前可以参看下载内容)

下载文件列表

syn_dp_fifo.v

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