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文件名称:sequence_detector(6-state)

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-09-12
  • 文件大小：
    1kb
  • 已下载：
    0次
  • 提 供 者：
    digita*******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

将《Verilog数字系统设计教程》(夏宇闻)一书中第15章的源代码进行了改进，由原来的8状态精简到6状态，同样可以实现要求的功能，对于重叠出现的特定序列也可以检测到。(The source code of Chapter 15 of the Verilog Digital System Design Tutorial (Xia Yuwen) has been improved from the original 8 state to the 6 state, and the required function can be achieved. For a specific sequence in which the overlap occurs, detected.)
相关搜索： 序列检测器 verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

sequence_detector(6-state)\sequence_detector.v
sequence_detector(6-state)\test_senquencedetector.v
sequence_detector(6-state)

相关说明

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