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文件名称:W5300

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-10-13
  • 文件大小：
    2.22mb
  • 已下载：
    1次
  • 提 供 者：
    leixia******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于Wiznet公司的W5300以太网解决方案，完成以太网通讯设计。该项目代码基于浩然电子的HS-NM5300A模块调试，可直接使用。(Based on Wiznet's W5300 Ethernet solution, complete the Ethernet communication design. The project code based on Hao Ran electronic HS-NM5300A module debugging, can be used directly.)
相关搜索： wiznet W5300 UDP tcp 以太网

(系统自动生成,下载前可以参看下载内容)

下载文件列表

W5300\DDR2\altmemphy-library\auk_ddr_hp_controller.ocp
W5300\DDR2\alt_mem_ddrx_addr_cmd.v
W5300\DDR2\alt_mem_ddrx_addr_cmd_wrap.v
W5300\DDR2\alt_mem_ddrx_arbiter.v
W5300\DDR2\alt_mem_ddrx_buffer.v
W5300\DDR2\alt_mem_ddrx_buffer_manager.v
W5300\DDR2\alt_mem_ddrx_burst_gen.v
W5300\DDR2\alt_mem_ddrx_burst_tracking.v
W5300\DDR2\alt_mem_ddrx_cmd_gen.v
W5300\DDR2\alt_mem_ddrx_controller.v
W5300\DDR2\alt_mem_ddrx_controller_st_top.v
W5300\DDR2\alt_mem_ddrx_csr.v
W5300\DDR2\alt_mem_ddrx_dataid_manager.v
W5300\DDR2\alt_mem_ddrx_ddr2_odt_gen.v
W5300\DDR2\alt_mem_ddrx_ddr3_odt_gen.v
W5300\DDR2\alt_mem_ddrx_define.iv
W5300\DDR2\alt_mem_ddrx_ecc_decoder.v
W5300\DDR2\alt_mem_ddrx_ecc_decoder_32_syn.v
W5300\DDR2\alt_mem_ddrx_ecc_decoder_64_syn.v
W5300\DDR2\alt_mem_ddrx_ecc_encoder.v
W5300\DDR2\alt_mem_ddrx_ecc_encoder_32_syn.v
W5300\DDR2\alt_mem_ddrx_ecc_encoder_64_syn.v
W5300\DDR2\alt_mem_ddrx_ecc_encoder_decoder_wrapper.v
W5300\DDR2\alt_mem_ddrx_fifo.v
W5300\DDR2\alt_mem_ddrx_input_if.v
W5300\DDR2\alt_mem_ddrx_list.v
W5300\DDR2\alt_mem_ddrx_lpddr2_addr_cmd.v
W5300\DDR2\alt_mem_ddrx_mm_st_converter.v
W5300\DDR2\alt_mem_ddrx_odt_gen.v
W5300\DDR2\alt_mem_ddrx_rank_timer.v
W5300\DDR2\alt_mem_ddrx_rdata_path.v
W5300\DDR2\alt_mem_ddrx_rdwr_data_tmg.v
W5300\DDR2\alt_mem_ddrx_sideband.v
W5300\DDR2\alt_mem_ddrx_tbp.v
W5300\DDR2\alt_mem_ddrx_timing_param.v
W5300\DDR2\alt_mem_ddrx_wdata_path.v
W5300\DDR2\alt_mem_phy_defines.v
W5300\DDR2\DDR2.ppf
W5300\DDR2\DDR2.qip
W5300\DDR2\DDR2.v
W5300\DDR2\DDR2_advisor.ipa
W5300\DDR2\DDR2_alt_mem_ddrx_controller_top.v
W5300\DDR2\DDR2_controller_phy.v
W5300\DDR2\DDR2_example_driver.v
W5300\DDR2\DDR2_example_top.sdc
W5300\DDR2\DDR2_example_top.v
W5300\DDR2\DDR2_example_top.v.tmp2
W5300\DDR2\DDR2_example_top_1.v
W5300\DDR2\DDR2_example_top_2.v
W5300\DDR2\DDR2_ex_lfsr8.v
W5300\DDR2\ddr2_high_performance_controller-library\auk_ddr_hp_controller.ocp
W5300\DDR2\DDR2_phy.qip
W5300\DDR2\DDR2_phy.v
W5300\DDR2\DDR2_phy_alt_mem_phy.v
W5300\DDR2\DDR2_phy_alt_mem_phy_pll.qip
W5300\DDR2\DDR2_phy_alt_mem_phy_pll.v
W5300\DDR2\DDR2_phy_alt_mem_phy_pll.v_.bak
W5300\DDR2\DDR2_phy_alt_mem_phy_pll_bb.v
W5300\DDR2\DDR2_phy_alt_mem_phy_seq.vhd
W5300\DDR2\DDR2_phy_alt_mem_phy_seq_wrapper.v
W5300\DDR2\DDR2_phy_ddr_pins.tcl
W5300\DDR2\DDR2_phy_ddr_timing.sdc
W5300\DDR2\DDR2_phy_ddr_timing.tcl
W5300\DDR2\DDR2_phy_report_timing.tcl
W5300\DDR2\DDR2_phy_report_timing_core.tcl
W5300\DDR2\DDR2_pin_assignments.tcl
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W5300\DDR2\testbench\DDR2_example_top_tb.v
W5300\DDR2\testbench\DDR2_example_top_tb.v.tmp2
W5300\DDR2\testbench\DDR2_example_top_tb_1.v
W5300\DDR2\testbench\DDR2_example_top_tb_2.v
W5300\DDR2\testbench\DDR2_full_mem_model.v
W5300\DDR2\testbench\DDR2_mem_model.v
W5300\DDR2_phy_autodetectedpins.tcl
W5300\DDR2_phy_summary.csv
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W5300\greybox_tmp\cbx_args.txt
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