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文件名称:RS编译码器verilog

  • 所属分类：
    硬件设计
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-10-18
  • 文件大小：
    8.21kb
  • 已下载：
    2次
  • 提 供 者：
    fengbobo
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本设计提供RS（255，247）码的编码和解码的Verilog源代码。
已验证0~4个错误的编码与解码功能。
相关搜索： rs编译码器，verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : rtl.rar 列表
rtl/chien.v
rtl/dec_ctrl.v
rtl/euclid.v
rtl/forney.v
rtl/gf256inv.v
rtl/gf256mul.v
rtl/rs_decoder.v
rtl/rs_encoder.v
rtl/syndrome.v
rtl

相关说明

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