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文件名称:一个简单的UART

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
  • 上传时间：
    2017-10-22
  • 文件大小：
    3kb
  • 已下载：
    0次
  • 提 供 者：
    ribbit******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

实现串口基本功能，具有奇偶检验，主时钟与波特率相差16倍(Basic function, a serial port with parity check, master clock and the baud rate is 16 times clk)
相关搜索： UART

(系统自动生成,下载前可以参看下载内容)

下载文件列表

一个简单的UART.vhd

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