文件名称:test_Project
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配置晓网模块，加测试文档，源代码和相关图片(Configure Xiao network module, add test documents, source code, and related pictures)
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下载文件列表
| 文件名 | 大小 | 更新时间 |
|---|---|---|
| test_Project\History\B2EB0A30\Louis Terminal.~(1).SchLib.Zip | 19785 | 2017-12-21 |
| test_Project\History\mySchlib1.~(1).SchLib.Zip | 2189 | 2017-12-20 |
| test_Project\History\mySchlib1.~(2).SchLib.Zip | 2217 | 2017-12-20 |
| test_Project\History\mySchlib1.~(3).SchLib.Zip | 2113 | 2017-12-20 |
| test_Project\History\mySchlib1.~(4).SchLib.Zip | 2073 | 2017-12-20 |
| test_Project\History\mySchlib1.~(5).SchLib.Zip | 2031 | 2017-12-20 |
| test_Project\History\mySchlib1.~(6).SchLib.Zip | 2050 | 2017-12-20 |
| test_Project\History\mySchlib1.~(7).SchLib.Zip | 2031 | 2017-12-21 |
| test_Project\History\mySchlib1.~(8).SchLib.Zip | 2031 | 2017-12-21 |
| test_Project\History\PCB1.~(1).PcbDoc.Zip | 24852 | 2017-12-21 |
| test_Project\History\PCB1.~(10).PcbDoc.Zip | 455625 | 2017-12-21 |
| test_Project\History\PCB1.~(11).PcbDoc.Zip | 455620 | 2017-12-21 |
| test_Project\History\PCB1.~(2).PcbDoc.Zip | 455808 | 2017-12-21 |
| test_Project\History\PCB1.~(3).PcbDoc.Zip | 455301 | 2017-12-21 |
| test_Project\History\PCB1.~(4).PcbDoc.Zip | 455835 | 2017-12-21 |
| test_Project\History\PCB1.~(5).PcbDoc.Zip | 455779 | 2017-12-21 |
| test_Project\History\PCB1.~(6).PcbDoc.Zip | 468816 | 2017-12-21 |
| test_Project\History\PCB1.~(7).PcbDoc.Zip | 468832 | 2017-12-21 |
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| test_Project\History\PcbLib1.~(10).PcbLib.Zip | 444847 | 2017-12-21 |
| test_Project\History\PcbLib1.~(11).PcbLib.Zip | 444840 | 2017-12-21 |
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| test_Project\History\PcbLib1.~(4).PcbLib.Zip | 444688 | 2017-12-21 |
| test_Project\History\PcbLib1.~(5).PcbLib.Zip | 444681 | 2017-12-21 |
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| test_Project\History\PcbLib1.~(9).PcbLib.Zip | 444836 | 2017-12-21 |
| test_Project\History\Sheet1.~(1).SchDoc.Zip | 2995 | 2017-12-20 |
| test_Project\History\Sheet1.~(2).SchDoc.Zip | 3732 | 2017-12-20 |
| test_Project\History\Sheet1.~(3).SchDoc.Zip | 3725 | 2017-12-21 |
| test_Project\History\Sheet1.~(4).SchDoc.Zip | 3886 | 2017-12-21 |
| test_Project\History\test_Project.~(1).PrjPcb.Zip | 4677 | 2017-12-20 |
| test_Project\History\test_Project.~(2).PrjPcb.Zip | 4728 | 2017-12-21 |
| test_Project\mySchlib1.SchLib | 9216 | 2017-12-21 |
| test_Project\PCB1.PcbDoc | 607232 | 2017-12-21 |
| test_Project\PcbLib1.PcbLib | 534016 | 2017-12-21 |
| test_Project\Project Logs for test_Project\PCB1 PCB ECO 2017-12-21 13-33-55.LOG | 1698 | 2017-12-21 |
| test_Project\Project Logs for test_Project\PCB1 PCB ECO 2017-12-21 15-29-59.LOG | 118 | 2017-12-21 |
| test_Project\Sheet1.SchDoc | 24576 | 2017-12-21 |
| test_Project\test_Project.IntLib | 5632 | 2017-12-21 |
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| test_Project\__Previews\AT long bus (13.3 x 4.2 inches).schdocPreview | 26503 | 2017-12-18 |
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| test_Project |
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